取指译码
2021-12-01 10:39:24 4 举报
CPU设计
作者其他创作
大纲/内容
IMME
rR1rR2rRD
CONTROL.reg_we
WD
CONTROL.alu_b
IROM
r1r2
ALU.b
4
PC
WD mux output
NPC
01
寄存器堆
ALU
ALU.a
WD mux in
ALU.c
CONTROL.npc_op
CONTROL.npc_sel
CONTROL.sext_op
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